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verilog按下一个按键key时产生一个单个矩形脉冲信号 已有1hz时钟

发布时间:2019-07-29 18:34 来源:未知 编辑:admin

  verilog按下一个按键key时产生一个单个矩形脉冲信号 已有1hz时钟信号clk

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  verilog按下一个按键key时产生一个单个矩形脉冲信号已有1hz时钟信号clk要求脉冲的长度为3s按键间隔远大于3s...

  verilog按下一个按键key时产生一个单个矩形脉冲信号 已有1hz时钟信号clk 要求脉冲的长度为3s 按键间隔远大于3s

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  展开全部将1HZ时钟信号做为一个输入时钟clock,一个周期为1s,要求脉冲长度为3S即需要持续3个clock周期,按照这个思路写代码。

  核心部分就是,对clock的上升沿进行计数,每个上升沿加1,判断按键是否按下,每次按下按键时,产生一个计数的使能信号,在使能信号有效时,进行计数,判断计数值到3时,输出一个脉冲,同时释放使能。

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